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X-WR-CALDESC:connpass-RTLを語る会(18) ～ おかえりaltera\, こん
 にちはGowin (仮) ～
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 にちはGowin (仮) ～
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SUMMARY:RTLを語る会(18) ～ おかえりaltera\, こんにちはGowin 
 (仮) ～
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DESCRIPTION:サブタイトルには特に意味はありません。画
 像は生成AIに作ってもらいました。\n\n## 概要\n\n今回も
 、ここでしか語れないエピソードも交えつつ、進めて
 いきたいと思います。\n\n前回実施した内容は下記リン
 クをご覧下さい。ご参考まで。\n\nhttps://talkrtl.connpass.com
 /event/285598/\n\n※管理者の判断により、参加をキャンセ
 ルさせていただく場合があります。ご了承下さい。\n\n#
 # 発表枠について\n\n若手発表枠は、30歳以下のためのも
 ので、試験的に導入してみました。是非お気軽にやっ
 ていることの発表をして頂ければと思います。\nまた、
 発表は6枠用意してありますが、発表者多数の場合は一
 人当たりの発表時間を短くして8枠まで増やす可能性あ
 りです。\n\n※尚、即席ライトニングトークもやろうと
 思っています。\n\n## タイムテーブル (暫定)\n\n* * *\n\n都
 合に合わせて大きく変わる場合があります。\n\n時間 | 
 内容 | 発表者  \n---|---|---  \n12:30 ~ 13:00 | 開場、受け付け
  |   \n13:00 ~ 13:10 | あいさつ | HK86  \n13:10 ~ 13:30 | 参加者自
 己紹介① | 参加者全員  \n13:30 ~ 13:55 | Verilator + Rust + gRPC 
 と Efinix の RISC-V で AIアクセラレータをAIで作ってる話 |
  Ryuz88さん  \n13:55 ~ 14:20 | GOWIN FPGAでいろいろ遊んでみた 
 | Kenta IDAさん  \n14:20 ~ 14:45 | Questa FSEでアサーション検証
 やってみた | AUDIYさん (若手発表)  \n14:45 ~ 15:15 | 休憩・
 参加者自己紹介②・ライトニングトーク① | 参加者全
 員 + LT希望者  \n15:15 ~ 15:40 | α世界線のSystemVerilogの話 | d
 s54eさん  \n15:40 ~ 16:05 | VerylとRISC-Vと検証とあれこれ | kan
 atasoさん (若手発表)  \n16:05 ~ 16:30 | Verylでつくる！FPGAフ
 ァミコン！ | たるいさん  \n16:30 ~ | ライトニングトーク
 ② + その他皆様と駄弁り | LT希望者  \n  \n* * *\n\n(発表20
 分、QA5分の計25分を想定)\n\n## シバク会（懇親会）\n\n語
 る会終了後に、RTLをシバク会（懇親会）を予定してい
 ます。奮ってご参加ください。\n\n参加希望の方は、\n\n
 https://connpass.com/event/369336/\n\nこちらから、参加登録をお
 願いします。\n\n* * *\n\n## FAQ\n\nQ: オンライン参加は可能
 ですか？\n\nA: できません。\n\nhttps://talkrtl.connpass.com/even
 t/367389/
LOCATION:東京都港区赤坂2丁目 (赤坂近辺)
URL:https://talkrtl.connpass.com/event/367389/
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